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            • ylösvetovastus
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            • Ylösvetovastus on vastus, joka varmistaa, että elektronisen komponentin tuloliitäntä on ylätilassa eli looginen ykkönen silloin, kun liitäntään ei ole kytketty muuta signaalia. Avokollektorilähtöinen kytkentä ei ykköstilassa ollessaan anna ollenkaan jännitettä, mutta ylösvetovastuksella seuraavan komponentin tuloon saadaan oikea ykköstilaa merkitsevä jännite. Kun avokollektorilähtö siirtyy nollatilaan, transistori alkaa johtaa, jolloin ylösvetovastuksen kautta tuleva sähkövirta ei riitä pitämään lähtöä ykköstilassa ja jännite putoaa nollatilaa vastaavaksi. Transistorin tilalla voi olla myös vaikkapa kytkin, jolla tulon tila saadaan tarvittaessa pakotettua nollaksi. Mikäli transistorin tilalle kytketään kondensaattori, asettuu jännite virran kytkemishetkellä nollatasolle, mutta kondensaattorin varauduttua jännite nousee ykköstasoa vastaavaksi. Tällaista vastuksen ja kondensaattorin muodostamaa RC-piiriä käytetään, kun halutaan esimerkiksi nollata mikropiiri virran kytkemishetkellä. Own research - by Arja Whiteside (X)
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            • felhúzó ellenállás
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          • Definition(s)
            • Logikai bemenetek magas vagy 1-es logikai logikai állapotba rögzítésére használják a felhúzó ellenállásokat. Ezáltal előzik meg azt, hogy bizonytalan állapotban legyenek a logikai bemenetek. Own research - by Katalin Szilárd
          • Example sentence(s)
            • A közepes teljesítményű PIC mikrovezérlők egyes portjai programozható (ki- és bekapcsolható) felhúzó ellenállásokkal vannak felszerelve, amivel tovább csökkenthető a szükséges külső alkatrészek száma. A programozható felhúzó ellenállások csak az adott port bemenetként konfigurált kivezetései esetében lépnek működésbe. A felhúzási áram 5V-os tápfeszültség mellett az 50..400µA-es tartományban van, amely egy 12,5 és 100kΩ közötti ellenállásnak (tipikusan 20kΩ) felel meg. Egy adott port felhúzó ellenállásai csak együttesen engedélyezhetőek az OPTION vezérlő regiszter ( vagy ) vezérlő bitjével. Ha a bit állapota logikai "0", a felhúzó ellenállások engedélyezettek, "1" érték esetén tiltva vannak. Az alaphelyzet a tiltott állapot, vagyis logikai "1". Egy felhúzó ellenállással bővített port-kivezetés kimeneti és adatirány-kiválasztó áramkörét mutatja be a következő ábra. - Freeweb by Katalin Szilárd
            • A busz elvi felépítése az 63. ábrán látható. A tranzisztorok kikapcsolt állapotában a felhúzó ellenállás miatt, a vonalak magas állapotban vannak. Ez az alaphelyzet. Ha bármelyik tranzisztort bekapcsoljuk, az a vezetéket a földre kapcsolja, így nulla állapotú. Ezt a megoldást az elektronikában huzalozott vagy kapcsolatnak hívják. - Szabilinux by Katalin Szilárd
            • TRISA értéke marad a szokásos. TRISB-t azonban ezúttal máshogy állítjuk be, mert a PORTB felső két bitje bemenetként funkcionál. Ennek megfelelően az alsó hat bitet outputra (0) kell állítani, a felső kettőt pedig inputra (1). Az OPTION_REG esetében az előosztó bitek (azaz az alsó három bit) nem jelent számunkra semmit, mert nem használunk Timer megszakítást. Az utolsó bit azonban már annál fontosabb. Ez az ún. felhúzó ellenállást kapcsolja ki vagy be. 1 esetén – amire éppen állítottuk is – kikapcsolja. A felhúzó ellenállás lényege, hogy ha egy láb bementként funkcionál, de fizikailag nincs rákötve semmi, akkor az általa visszaadott érték kiszámíthatatlan. A felhúzó ellenállás lényege, hogy ha egy ellenálláson keresztül a +5V-ra kötjük ezt a lábat, akkor ilyen esetben megkapja a +5V-ot a láb, vagyis a kiszámíthatatlanság helyett biztosan egyet ad vissza. Rendszerint ezt érdemes mindig bekapcsolva tartani, mi azonban most azért kapcsoljuk ki, mert ezt az ellenállást már az áramkörünkben megvalósítottuk. (Lásd ábra.) - Freeweb by Katalin Szilárd
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            • 上拉电阻(器)
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          • Definition(s)
            • 在数字逻辑电路中，由于某些引脚空闲不用，又不能悬空着，通常用一适当的电阻接+vcc（上拉）或地（下拉）。具体使用上拉或下拉要看设计而定，大多不能随意改变。当然电阻本身是没有什么区别的。 上拉电阻： 1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。 2、OC门电路必须加上拉电阻，才能使用。 3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。 4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。 5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。 6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。 7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。 上拉电阻阻值的选择原则包括: 1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。 2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。 3、对于高速电路，过大的上拉电阻可能边沿变平缓。综合考虑 以上三点,通常在1k到10k之间选取。对下拉电阻也有类似道理 YAHOO - by Adsion Liu
          • Example sentence(s)
            • 上拉是对器件注入电流，下拉是输出电流；弱强只是上拉电阻的阻值不同，没有什么严格区分；对于非集电极（或漏极）开路输出型电路（如普通门电路）提升 ... - http://forum.eepw.com.cn by Adsion Liu
            • 上拉是对器件注入电流，下拉是输出电流；弱强只是上拉电阻的阻值不同，没有什么严格区分；对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力 ... - http://baike.baidu.com by Adsion Liu
            • 上拉電阻：pull up1、當TTL電路驅動COMS電路時，如果TTL電路輸出的高電平低於COMS電路的最低高電平（一般為3.5V），這時就需要在TTL的輸出端接上拉電阻，以提高輸出高 ... - http://kelvin820.pixnet.net by Adsion Liu
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            • プルアップ抵抗
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          • Definition(s)
            • プルアップ抵抗（プルアップていこう、英: pull-up resistor）とは、電子論理回路において外部デバイスが切断されても入力端子が適切な論理レベルのままとなるよう使われる抵抗器である。また、電圧レベルの異なる2つの論理回路を相互接続する際にも使う。 Wikipedia - by Yasutomo Kanazawa
          • Example sentence(s)
            • ここでもRが無いと、SWがOFFのときに宙ぶらりんになり不安定になります。 このようにVCCレベルの電位をはっきりさせるために取り付ける抵抗を 「プルアップ抵抗」といいます。 - プルアップ、プルダウン by Yasutomo Kanazawa
            • その目的は主として、「そのラインに何も接続されていない状態になった時」に、そのラインの電位を「Hレベル」に固定することにある。 CPU等が、回路からの入力を判断する基準は電圧である。しかしもし、回路がどこにも接続されない状態の場合、その回路のレベルはHかLかはっきりしない、宙に浮いた状態となる。これでは、CPU等は入力がONなのかOFFなのか判断できない。 プルアップは、入力レベルがVCCレベル(Hレベル)であることを明確にするために行なわれ、この目的のためにプルアップ抵抗が取り付けられる。 - プルアップ - 通信用語の基礎� by Yasutomo Kanazawa
            • 上図でのプルアップ抵抗値はいくつか良いのでしょうか。これを決める方法には、 下記のパラメータが関係します。 　(1) 電源電圧（Vdd) 　　　　電源電圧はプルアップ抵抗の最小値を制限します。 　　　　これには各ドライバのシンク電流が最大３mAという制限があるので、Ｏｎ電圧 　　　　が０．４Ｖmaxとすれば、下記条件が必要です。 　　　　　　　Rp　＞　（Vdd－０．４）／３ｍＡ 　　　　例えばVdd＝５Vとすれば　　Rp ＞ １．５ｋΩ　となります。 　(2) バスの浮遊容量 　　　浮遊容量とプルアップ抵抗で形成する時定数で、パルスの立ち上がり時間を 　　　決めるので、これでプルアップ抵抗の最大値が決まります。 　　　立ち上がり時間は下記が最大値として規定されています。 　　　　　　　　　　　　　　　　　　　　　　　　　　　《単位nsec》 　　　　　　通信速度　　　　　立上がり時間　　　　立下り時間 　　　　　・１００ｋｂｐｓ　　　　　１０００　　　　　　　　　３００　　 　　　　　・４００ｋｂｐｓ　　　　　　３００　　　　　　　　　３００ 　　　　　・１．７Mbps　　　　　　　８０　　　　　　　　　　８０　　(400pF) 　　　　　・３．４Mbps　　　　　　　４０　　　　　　　　　　４０　　(100pF) 　　　　　 　　　　　例えば１００ｐFで３００nsecとすれば 　　　　　　　　Rp ＜　３００nsec／１００ｐF ＝　３ｋΩ　となります。 　(3) 接続されたデバイスの数と入力電流 　　　入力電流の加算による電圧降下を上記電圧配分に加える必要がある。 　　　しかし入力電流はわずかなことが多いので省略しても大きな問題は無い。 結局これらから、電源が５Vで１００ｋｂｐｓまたは４００ｋｂｐｓの時には２ｋΩ～５ｋΩが 最適値ということになります。 - 電子工作室 by Yasutomo Kanazawa
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            • مقاومة رفع للأعلى
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          • Definition(s)
            • أولا سنتكلم عن المصطلح العربي في بحثك على شبكة الانترنت ستلاحظ وجود تعريفين : الأول مقاومة الرفع والثاني مقاومة شد للأعلى لكنني وجدت أن "مقاومة شد للأعلى" مصطلح قليل الشيوع إضافة إلى أن مصطلح "مقاومة شد" مستخدم بكثير في علم الهندسة المدنية الآن من الناحية الهندسية، لا فرق عمليا بين مقاومة الرفع ومقاومة الخفض أو ما يعرف ب pull-down resistor لذا الشرح هنا سيتكرر عند شرحي لذلك المصطلح. أولا ألق نظرة على المرجع بالأعلى. هنا الشرح عن مقاومة الرفع. في الصورة الأولى هناك بوابة منطقية متروكة بدون توصيل يد وهذا وضع سيء. في الصورة الثانية تم توصيلها توصيلا صحيحا. المشكلة هي عند إغلاق المفتاح فسيكون هناك اتصال مباشر بين البطارية و الأرض مما يتسبب بدائرة قطع أي شورت سيركت وفي أحسن الأحوال سيطفئ دائرتك وفي أسوئها سيحرقها. الحل؟ في الصورة الثالثثة. كما ترى هناك مقاومة متصلة بالبطارية وفائدتها أنه في حال تم اغلاق المفتاح لن يكون هناك تماس فالتيار لن يمر من البطارية للأرض مباشرة بل عليه أن يمر خلال المقاومة والتي عادة تككون لها القيمة 10000 أوم (ليس بالضبط لكن المهم أن تكون قيمة كبيرة نسبيا) مما سيقلل التيار المار نفس الشيء تماما بالنسبة لمقاومة الخفض. كما بالصورة الرابعة. متى نحتاج مقاومة الخفض؟ اذا كان المفتاح كما تلاحظ موصلا في الطرف القريب من البطارية اذن عمليا لا فرق فقط تغيير الاماكن والتفسير واحدد في الحالتين ما نريده هو منع حدوث دائرة قطع او شورت سيركت seattle robotics - by Ali Alsaqqa
          • Example sentence(s)
            • حالة مقاومة الرفع الداخلية (pullup) : يمكن لكل مغرز تأمين مقاومة رفع داخلية ، وهذا يحدث عند إعطاء السجلPORT القيمة 1 عند استخدامه كسجل تحكم أي أن البوابة معرفة كدخل - عالم الالكترون by Ali Alsaqqa
            • تمتلك أقطاب النافذة P0 مقاومة رفع داخلية (PULL-UP) فقط في هذا النمط. - ويكيبيديا by Ali Alsaqqa
            • Both pull-up resistors and pull-down resistors are used in electronic logic circuits to ensure that inputs to logic systems settle at expected logic levels if external devices are disconnected or high-impedance - wikipedia by Ali Alsaqqa
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  • Compare this term in: Serbian, Czech, German, Greek, English, Spanish, French, Italian, Polish, Portuguese, Romanian, Russian

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